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[单选题]
若D触发器的现态为0,要使D触发器的次态Qn+1为1,应满足如下条件()。
A.SD=1、RD=0、CP下降沿、D=1
B.SD=1、RD=0、CP上升沿、D=1
C.SD=1、RD=1、CP上升沿、D=1
D.SD=1、RD=1、CP下降沿、D=1
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A.SD=1、RD=0、CP下降沿、D=1
B.SD=1、RD=0、CP上升沿、D=1
C.SD=1、RD=1、CP上升沿、D=1
D.SD=1、RD=1、CP下降沿、D=1
写出图P5.20(a)电路中触发器次态Q'与现态Q和A、B之间关系的逻辑函数式,并画出在图P5.20(b)给定的输入电压波形下触发器输出的电压波形。设触发器的初始状态为Q=0。
A.0
B.1
C. φ
D.不变
JK触发器组成图3.3(a)所示电路.试分析电路的逻辑功能.已知电路CLK和A的输入波形如图3.3(b)所示.设Q输出初态为0,画出Q的波形.
由主从JK触发器和555定时器组成的电路如图6.17(a)所示.已知CP为10Hz的方波,如图6.17(b)所示.R1=10kΩ、R2=56kΩ、C1=1000pF、C2=4.7uF,触发器Q端及555输出端(3端)初态均为“0".
(1)试画出Q端,u1、uO相对于CP脉冲的波形.
(2)试求Q端输出波形的周期.
触发器起始均为0态)